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双DSP结构的捷联控制与解算系统设计
设计了基于双DSP结构的捷联控制与解算系统.该系统以高性能的浮点处理器TMS320VC33作为捷联系统实时解算的核心,以TMS320VC5402作为通道控制、数据采集的控制核心.并结合FPGA的组合逻辑和时序逻辑,构成了高集成度的嵌入式系统.该系统具有采样速度快、浮点处理精度高、稳定性好等特点.可以充分满足捷联导航系统的要求.
作 者： 高延滨 孙华 曾建辉 GAO Yan-bin SUN Hua ZENG Jian-hui 作者单位： 哈尔滨工程大学,哈尔滨,150001 刊 名： 微计算机信息 PKU 英文刊名： CONTROL & AUTOMATION 年，卷(期)： 2008 24(28) 分类号： V249.3 关键词： 捷联惯导系统 DSP FPGA HPI【双DSP结构的捷联控制与解算系统设计】相关文章：
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